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sdf: standard delay format
spef: standard parasitic exchange format
synthesis後的sdf包含了gate和wire(wire load model)的delay資訊，但因為合成無法反應出實際chip上擺放的情況所以繞線的delay是粗估的，並不準確。
post-layout 後的sdf包含了gate和wire的delay資訊。
spef可由APR tool或RC extraction的tool產生，其內記錄了R、C等寄生參數。
可使用PT讀入layout後的spef資訊，寫成新的sdf做post-layout的STA，較準確。
參考連結：'
http://www.edaboard.com/thread44258.html
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